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- 16:00 落としてきたサンプルコードがテキストの図と一致しない件について。 #
- 18:06 777! #
- 18:13 色々と疲れた。特に何かしたでもないのに。 #
- 20:02 設計開始前のうわついた状態が大好きなのだけれどもそこへすら至らない。 #
- 21:54 命令デコーダはとりあえず完了。 #
- 21:55 文化祭は恒例のごとく機材提供だけで仕事はなさそうです。 #
- 22:51 生成したインスタンス名なんぞ二度と打たないのだからフルスペルで書けよ。と思う。 #
- 22:53 合成した後の回路図にも表示されるのだから、それぐらいしてもいいと思う。 #
- 22:53 これが紙面の都合というやつか。 #
- 22:59 HDLは別に逐次ではないから、記述順と動作は関係ないのね。 #
- 23:34 32bitプロセッサなのにALUの精度が4bitってなによ。 #
- 23:49 新しいシンボルを1bitのwireと仮定して実行とか、バグの原因にしかならんだろう。せめてWarningぐらいだしてよ。 #
- 23:57 またtypoかよ。 #
- 23:59 やっとテストベンチ通った。 #
- 00:01 とりあえず合成してみるか。 #
